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凡亿是国内领先的电子研发和技术培训提供商,是国家认定的高新技术企业。以“凡亿电路”“凡亿教育”作为双品牌战略,目前近110万电子会员,技术储备为社会持续输送7万余人高级工程师,服务了1万多中小型企业合作伙伴。
Xilinx作为全球知名的FPGA厂商,旗下产品一直以来是FPGA工程师的必入FPGA产品之作,然而关于Xilinx的FPGA产品非常多,所以今天本文将介绍Sparan-2和Sparan-2E,希望对小伙伴们有所帮助。Sparan系列适用于
电子发烧友网报道(文/程文智)不久前,Microchip发布新闻稿介绍了其新的中等带宽现场可编程门阵列(FPGA)和FPGA系统级芯片(SoC)器件。据其新闻稿介绍,新的FPGA和SoC产品将静态功耗降低了一半,与同类器件相比,具有最小的发热区域,但却并没有损失性能和计算能力。该新产品就是低密度Po
虽然很多人没听说过移动站接收机,但移动站接收机在无线通信和智能手机方面应用广泛,是常见的电子组件之一,在智能手机模块里是以FPGA实现的,所以本文将分享移动站接收机的FPGA实现步骤。移动站接收机要实现的功能有导频信道伪随机序列的捕获、跟踪
MachXO2 可编程逻辑器件 (PLD) 由六个超低功耗、即时启动、非易失性 PLD 组成,可提供 256 至 6864 个查找表 (LUT) 的密度。 MachXO2 系列 PLD 提供了多种特性,例如嵌入式块 RAM (EBR)、分布
随着微电子技术发展,可编程逻辑控制器(PLC)在数码产品的带动下,开始成为大火的半导体产业之一,这也促使PLC种类繁多,相关故障问题也越来越多,所以本文将分享PLC常见的故障分析及维修方法。1、电磁干扰电磁干扰故障常发生在新机床调试阶段机床
随着微电子技术的发展,FPGA逐渐替代PDL等可编程逻辑器件应用在各个领域,但CPLD因其独特的特点性质,仍然比FPGA更适合应用在部分领域,但由于很多小白没装没接触过CPLD芯片,也不清楚其结构,所以本文将探讨CPLD芯片的内部结构。CP
Xilinx(赛灵思)公司作为全球知名的FPGA厂商,自从创先开发FPGA,一直以来是FPGA企业的领先军,但很多人不知道Xilinx也是优秀的CPLD厂商,今天我们将盘点Xilinx两类CPLD系列产品,也就是XC9500系列和CoolR
FPGA和CPLD都属于可编程逻辑器件,有着很多共同特点,但由于FPGA和CPLD的结构差异,所以它们的区别也很大,所以本文将详谈FPGA和CPLD的区别及联系。1、CPLD更适合完成各种算法和组合逻辑,FPGA更适合完成时序逻辑。换句话说
随着数字电路应用领域越来越多,可编程逻辑器件(Programma Logic Device,PLD)在其带动下也成为大火的电子器件之一,这也促使了PLD芯片制造工艺的日益完善,所以我们接下来将盘点可编程逻辑器件PLD芯片制造工艺。可编程逻辑
在FPGA设计时,我们总会遇到各种各样的设计难题,并发愁如何解决,所以小编将搜集网络上九个小白最头疼的FPGA设计问题,并进行回答,希望对小白有所帮助。1、如何控制XST插入buffer?①用buffer_type约束,具体使用方法在XST
PlanAhead虽然很少被人广为所知,但作为FPGA项目的布局布线常用软件之一,重要性不亚于其它EDA软件,但由于很多小白对它不甚了解,所以本文将搜集平台信息,总结出PlanAhead的功能及使用方法。PlanAhead工具简化了综合与布
随着微电子技术的不断发展,FPGA和ASIC的性能也变得越来越优越,也开始被广泛应用在电子电路与系统的开发和调试阶段,这也促使了FPGA的配置电路模式发展。FPGA配置方式灵活多样,根据芯片是否能够主动加载配置数据分为主模式、从模式及JTA
时序性能是FPGA设计最重要的技术指标之一,在项目设计中很多人经常会遇见时序性能差的现象,但不知道该如何解决。造成时序性能差的根本原因有很多1、布局太差如图所示:该图是布局太差的时序报告示意图,其中附加的周围约束为3nm,实际周期为3.02
FPGA的时序分析及时序约束一直以来是小白难以搞懂的知识点,经常劝退不少小白,尤其是其中的偏移约束,所以本文将重点谈谈偏移约束。偏移约束属于基本时序约束,规定了外部时钟和数据输入输出引脚之间的相对时序关系,智能用于端口信号,不能应用于内部信
目前微电子技术已发展到SOC阶段,即集成系统阶段,相对于集成电路(IC)的设计思想有着革命性的变化。FPGA自然也不例外,但有很多小白不太清楚基于FPGA芯片的SOC开发流程,所以本文将回答这个问题。1、基于FPGA的SOC设计方法目前,由
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