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提问了一个关于的Sigrity仿真问题
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2025-11-20 22:51

点击曲线图后报错,环境变量已配置,env文件已配置,求解决原因。 查看回答

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提问了一个关于的Cadence Allegro问题
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2025-10-25 15:46

请问allegro中走线等长设计,是看下面那个参数? 查看回答

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提问了一个关于的嘉立创EDA问题
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2025-10-05 20:38

请问,7吋RGB888显示屏(分辨率800*480,像素时钟频率33MHz)在和MCU (STM32F429IGT6)连接时,对显示屏的数据线和时钟线 PCB 设计有什么要求?谢谢。 查看回答

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提问了一个关于的Cadence Allegro问题
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2025-09-29 15:12
提问了一个关于的Cadence Allegro问题
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2025-09-22 15:24

各位大佬,想请问allegro软件17.4版本怎么设置抓取命令,如抓取via或者pin等 查看回答

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提问了一个关于的Altium/Protel问题
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2025-08-13 11:20

在PCB布局的时候找不到GND网络,请问怎么解决? 查看回答

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提问了一个关于的Altium/Protel问题
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2025-08-06 13:58
未解决

不显示绿油

3D 为啥不能显示绿油呀 查看回答

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提问了一个关于的Altium/Protel问题
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2025-07-31 16:39

求助大佬们!AD如何把Via加入到传播延时计算 查看回答

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提问了一个关于的Altium/Protel问题
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2025-07-25 16:44

ad的阻焊层打开看不到阻焊 查看回答

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提问了一个关于的Altium/Protel问题
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2025-07-18 09:45

请教一下大佬们,AD怎么批量修改经过蛇形等长处理后的走线宽度?在线等,很着急 查看回答

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