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在所创建的原理图下面的Library图标单击右键,选中Add File,在所弹出的窗口中找到所要调用的库路径,进行打开,如图所示
时钟信号需要包地处理差分等长误差控制在+-5milrx和tx都需要等长处理需要建立等长组
差分走线需要再优化一下2.此处差分尽量打孔换层,在旁边添加一对回流地过孔,包地即可3.电容靠近管脚放置,走线优化一下,不要有锐角4.焊盘中心出线至外部才能拐线处理,避免生产出现虚焊5.存在多处开路6.差分需要进行对内等长,误差5mil7.R
确认一下此处是否满足载流,自己加宽一下铜皮2.注意等长线需要满足3W规则3.注意器件摆放不要干涉1脚标识以上评审报告来源于凡亿教育邮件公益作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教:https://item.taobao.c
注意电感所在层的内部需要挖空处理2.注意滤波电容摆放应该先大后小摆放3.开关电源电感下面应该避免走线4.芯片采用单点接地,其他部分应该避免打孔,只需要在芯片中间打孔即可5.后期需要在底层铺整版地铜
晶振走内差分需要再优化一下2.模拟信号走一字型布局,没空间就调整旁边的器件和走线3.跨接器件旁边尽量多打地过孔,间距建议2mm,贴片器件建议离定位孔远一下可以参考一下此图4.地址线,控制线和时钟信号未创建等长组进行等长5.此处走线能拉直尽量
做Allegro实战视频教学的先深圳市凡亿技术开发有限公司设计中心技术总监;凡亿教育创始人;PCB联盟网电子论坛特邀版主;长期致力于Cadence Allegro高速PCB设计与Cadence Allegro 高速PCB设计视频教学;具备丰富的PCB设计实战经验,尤其擅长高速信号数字类、消费电子类产品的PCB设计。其系列Cadence Allegro软件速成视频教程、Cadence Allegro版PCB设计全流程实战视频深受业界PCB爱好者的赞誉,是开启PCB实战视频教学的先驱者。驱者
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