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晶振可以在靠近管脚一些。差分锯齿等长不要大于两倍间距散热过孔正反都要开窗处理走线不满足3w间距这里输出要加粗处理电容按先大后小放置走线不要穿过电容电阻

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PCB Layout 2023-05-24 16:18:23
20天PCB设计与DFM可制造性线上特训营 _STM32开发板V1.0作业评审

差分换层,旁边需要打地过孔2.差分线可以在优化一下3.晶振需要包地处理4.焊盘出线与焊盘同宽即可,拉出来再进行加粗5.电源存在多处开路以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教

90天全能特训班18期 allegro -one piece-千兆网口

模拟信号需要一字型布局,单根包地处理2.晶振需要走内差分处理3.跨接器件旁边尽量多打地过孔,间距最少1mm,有器件不满足可以忽略,其他地方要尽量满足4.差分走线要尽量耦合5.百兆出差分信号外,其他信号都需要加粗到20mil6.模拟信号需要一

90天全能特训班18期 allegro -孟悦 -达芬奇

晶振靠近管脚放置,尽量少打孔换层,包地处理2.差分包地地线上需要多打地过孔3.器件摆放尽量对齐处理4.注意过孔不要上焊盘后期自己检查一下过孔上焊盘和过孔重叠5.信号包地应该用地网络,不要用电源6.SD卡组内误差不能超过400mil7.注意走

90天全能特训班18期 allegro -觅一惘 -STM32

1.电源输入应该多打过孔加大载流2.差分布线避免直角,换层应靠近打一对回流地过孔3.晶振需要包地处理4.232C+C-,V+V-所接电容需要加粗走线

90天全能特训班18期-AD李侠鑫-第九次作业-STM32最小系统两层板 -作业评审

1.232的升压电容走线需要加粗2.走线尽量不要从小电阻电容中间穿线,容易造成短路3.USB走线不满足差分间距规则,可以打孔4.焊盘出线需要优化一下,拉出焊盘在进行加粗5.晶振需要包地处理,其他信号线不要从晶振里面穿6.USB差分对内等长5

90天全能特训班18期 AD --iYUN-STM32

晶振走内差分需要再优化一下2.地分割间距最少满足1mm3.锯齿状等长不能超过线距的两倍4.网口除差分线外,其他的都需要加粗到20mil5.模拟信号尽量一字型布局6.电感所在层的内部需要挖空7.反馈需要从最后一个电容后面取样8.数据线和地址线

90天全能特训班18期 allegro -one piece -达芬奇

晶振走内差分需要再优化一下2.地分割间距最少1mm,建议2mm,有器件的地方可以不满足3.反馈信号走线需要加粗4.电感中间挖空就不要有铜皮5.输出打孔要打在电容后面6.注意过孔尽量盖油,不要上焊盘以上评审报告来源于凡亿教育90天高速PCB特

90天全能特训班17期 AD - 李天昊-达芬奇

1.485信号需要走内差分处理,后期自己调整一下布局,然后重新走线2.晶振优先布局,走线路劲要尽量短3.晶振注意电容摆放顺序,先经过电容,在到晶振4.差分出线要耦合,走线尽量不要走小器件中间,容易造成短路5.差分对内等长处理不当,锯齿状等长

90天全能特训班18期 AD - iYUN-达芬奇

分割地之间的间距最少要1mm以上2.晶振需要走内差分,并包地3.焊盘中心出线至外部才能拐线处理,避免生产出现虚焊,走与焊盘同宽拉出来再进行加粗4.变压器除擦还分信号外,其他的都需要加粗到20mil5.变压器需要所有层挖空以上评审报告来源于凡

90天全能特训班19期 allegro - faker-千兆模块