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答:Allegro导出封装库时,一般我们会勾选No library dependencies选项,如图5-207所示:
图5-207 导出封装库选项图
如果不勾选此项的话,可能会导致在导出封装库的时候,有焊盘或者Device导不出来。
此处电源走线要注意满足载流2.晶振需要走内差分,并包地处理3.器件摆放不要挡住一脚标识4.注意等长线之间需要满足3W5.注意电源要满足载流6.变压器要所有层挖空处理以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班
答:我们对于高速信号传输,比如差分信号、一组总线传输,都需要对其进行时序等长处理,在16.6版本以上,Allegro软件推出了自动等长的功能,在空间足够的情况下,是可以采用自动等长的功能,省去手动绕等长的时间,具体操作步骤如下所示:
答:我们这里所说的铜皮避让区域,一般指的是手动去对铜皮进行修整过的地方。在处理相同模块的时候,这个手动进行调整过的地方是可以进行复制的,这里讲解一下,如何对修整好的铜皮避让区域进行复制以及其它操作,具体如下:
答:当PCB设计完成以后,需要输出相关的光绘文件,在这之前,我们需要提取钻孔的信息,我们这里讲解一下,如何去查看PCB文件上的钻孔文件信息,具体操作如下所示:
当布线效果不理想时,,调整布线状态时,一根一根改比较费时,可以采用删除命令,将不需要的线删除后,重新布线。
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