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走线尽量拉直，自己优化一下2.等长线之间需要满足3W3.线宽尽量保持一致4.电容摆放尽量先经过电容在进入管脚5.跨接器件旁边尽量多大地过孔SD时钟信号尽量单根包地以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课
注意等长线之间需要满足3W2.锯齿状等长不难过超过县局的两倍3.线宽尽量保持一致4.此处不满足载流5.pcb上存在多处开路6.跨接期间旁边尽量多打过孔以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链
电感所在层测内部需要挖空处理2.地分割间距最少控制1mm以上，有跨接器件的地方不满足可以忽略，其他地方尽量一致3.除差分线外，其他的都需要加粗到20mil4.注意过孔尽量不要上焊盘5.注意等长线之间需要满足3W6.地址线也需要添加等长组进行
电感当前层的内部挖空处理：上述一致问题：注意不同地之间至少满足2MM间距：变压器信号除了差分信号，其他加粗20MIL走线：注意差分对内等长的GAP大于等于3W：焊盘扇孔注意对齐扇出：注意等长线之间满足3W间距原则可以调整下：注意的过孔之间的
注意电源地跟机壳地之间满足至少2MM间距：器件注意放置完全，并且放置完成之后走线连接：把没有设计的器件布局布线设计下。变压器除了差分信号，其他信号也要走线连接完全：还存在多处飞线，存在信号没有连接完全：等长线之间需要满足3W间距：注意等长还
![全能19期-allegro_THE的_第三次作业[2]千兆网卡PCB设计](https://api.fanyedu.com/uploads/ueditor/image/20230711/1689056641694508.png)
跨接器件旁边尽量多打地过孔，间距最少1mm，有器件的地方可以不满足2.地网络直接就近打孔，走线不要从小器件中间穿，容易造成短路3.等长存在误差报错4.注意等长线之间需要满足3W间距5.注意一下此处是否满足载流6.器件摆放不要干涉一脚标识7.
此处电源走线要注意满足载流2.晶振需要走内差分，并包地处理3.器件摆放不要挡住一脚标识4.注意等长线之间需要满足3W5.注意电源要满足载流6.变压器要所有层挖空处理以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班
注意数据跟地址，时钟，控制之间用GND走线隔开：建议等长线的GAP也尽量满足3W，避免自身的串扰：等长不是很美观，尽量采取咬合等长，既美观也节省空间，还可以调整下美观性：上述一致原因，注意等长线的gap：其他的等长没什么问题，只要是等长美观
GND跟电源网路都没有处理：地址线都有及个别的没有跟BGA内的扇孔连接：等长线的GAP尽量大于等于3W，不要太短了：数据线一组走线尽量紧凑点：看下是否存在间距报错:等长线之间要满足3W间距原则：上述一致问题，等长线GAP满足下3W长度：间距
电源信号都没有处理：注意等长线的GAP尽量满足大于等于3W长度：可以减少串扰。注意看下xsignals分组 U16 -U17没有信号：数据跟地址用GND走线隔开：此处电源可以在电源层分割：以上评审报告来源于凡亿教育90天高速PCB特训班作业
