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AD-全能19期-宋文孝-第五次作业-SDRAM设计

2023-07-31 10:20
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GND跟电源网路都没有处理:

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地址线都有及个别的没有跟BGA内的扇孔连接:

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等长线的GAP尽量大于等于3W,不要太短了:

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数据线一组走线尽量紧凑点:

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看下是否存在间距报错:

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等长线之间要满足3W间距原则:

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上述一致问题,等长线GAP满足下3W长度:

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间距报错:

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地址时钟控制线等长报错:

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看下自己的xsignals分组有问题没 U16-u17并没有信号:

image.png

以上评审报告来源于凡亿教育90天高速PCB特训班作业评审
如需了解PCB特训班课程可以访问链接或扫码联系助教:
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