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走线需要优化一下2.差分出线要尽量耦合3.注意此处是否满足载流4.此处可以从焊盘角出线，尽量不要有直角5.时钟信号需要包地处理6.焊盘中心出线至外部才能拐线处理，避免生产出现虚焊7.差分需要进行对内等长，误差5mil8.PX和TX之间需要用
网口除差分信号外，其他的都需要加粗到20mil2.差分出线要尽量耦合3.差分需要进行对内等长，误差5mil4.注意RX和TX创建等长组，走线需要满足3W间距5.注意线宽尽量保持一下6.过孔尽量不要打在两个焊盘中间，7.焊盘上存在多余的线头以
USB2.0注意铜皮不要有任意角度USB3.0差分对内等长锯齿状不能超过线距的两倍2.此处采用兼容设计，两个电阻可以放置在共模电感上面3.打孔要打在电容之前，注意 线宽要保持一致4.差分走要耦合5.差分对，间距最少保持20mil6.存在多余
差分对内等长误差控制在+-5mil内这个过孔打太近了散热过孔要两面开窗处理这个差分出线不太耦合整版铺一下铜以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教：https://item.
1.差分布线没有包地，需要每对差分单独包地打孔处理 2.差分换层旁边需要靠近打两个地过孔z3.差分布线长距离不耦合 4.差分没有等长，需要分组等长和对内等长处理 5.差分信号布线造成回路，应放置在后面尽量保持信号流向顺畅。 6. 存在飞线没
网口差分需要进行对内等长，误差5mil2.差分走线要尽量耦合3.差分走线可以在进行一下优化4.时钟信号需要单独包地处理5.电容尽量靠近管脚摆放6.此处走线尽量与焊盘同宽，拉出来再进行加粗，加粗尽量渐变，不要突然变很大7.中间可以多打过孔进行
1、电容地信号走线需要加粗2、过孔尺寸一般是8-16/10-20、12-22。3、多处孤岛铜皮和尖岬铜皮4、差分走线不耦合以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教：https
1、外壳地和GND底层铺铜没有分割2、外壳地与GND之间距离需要2mm以上3、跨接区域需要多打孔，外壳地这边也需要多打孔4、多处孤岛铜皮和尖岬铜皮5、差分布线不耦合6、差分换层需要旁边打过孔7、多余过孔没有删除8、电源走线需要加粗走线9、焊
差分走线要耦合出线2.差分对内等长凸起高度不能超过线距的两倍3.器件摆放干涉，后期自己调整一下放底层4.器件摆放太近5.滤波电容尽量保证一个管脚一个，原理图不够可以自己添加6.过孔不要上焊盘7.差分出线要尽量耦合以上评审报告来源于凡亿教育9
差分走线包地尽量包全：此处扇孔重新优化下：此处连接两个过孔一起连接上，不然另一个过孔没有用：CC1 CC2信号需要加粗走线：此处差分走线完全不耦合 ，不合格：差分对内等长注意需要符合规范：好多差分走线以及对内等长不符合规范，都需要修改。以上
