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差分对内等长误差大于5mil
两个地间距除跨接器件处外要大于1.5mm
时钟需要包地
过孔盘粘一起了调整一下
以上评审报告来源于凡亿教育90天高速PCB特训班作业评审
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1.电源输入应该多打过孔加大载流2.差分布线避免直角,换层应靠近打一对回流地过孔3.晶振需要包地处理4.232C+C-,V+V-所接电容需要加粗走线
我们在进行PCB设计的时候,第一步就是进行元件库的创建,那么在进行元件设计的时候很多时候会碰到多管教的元件,如果我们一个一个去放置的话,就会非常的繁琐,浪费很多的时间。所以,我们今天就来讲解一下在AD中做元件库的的时候怎么快速放置很多管脚,而不是需要我们一个一个去点击放置。
注意差分对内等长凸起高度不能超过线距的两倍差分尽量哪里不耦合就在哪里绕,尽量不要在中间绕蛇形2.差分出线需要耦合,后期自己调整一下3.走线尽量不要有锐角,后期自己优化一下4.时钟信号需要包地处理,并在地线上打孔,建议50-100mil一个以
网口除差分信号外,其他信号都需要加粗到20mil2.注意网口的地分割,跨接器件旁要多打地过孔,分割间距2mm后期自己处理一下3.差分出线需要优化一下,器件可以摆放远一点,包地的线要需要均匀打上过孔4.注意差分信号需要按照阻抗线距进行走线晶振
网口的差分信号需要对内等长,误差5mil2.差分出线要尽量耦合3.走线未连接到过孔中心4.RJ45座子需要挖空5.pcb上存在短路6.差分走线不满足差分规则7.锯齿状等长不能超过线距的两倍8.出线宽度超焊盘宽度,与焊盘同宽即可9.时钟包地需
哥只是个传说,不要迷恋哥!
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