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DDR3尽量采用菊花链形式,效果更加
2.注意数据线之间等长需要满足3W间距规则
3.注意VREF电源走线需要加粗到15mil以上,尽量不要有锐角
以上评审报告来源于凡亿教育90天高速PCB特训班作业评审
如需了解PCB特训班课程可以访问链接或扫码联系助教:
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Altium Designer是PCB设计的首选软件,是电子工程师需要掌握的软件之一,不会使用Altium Designer,意味着不是一个合格的工程师。今天凡亿教育将盘点Altium Designer 18软件的分层设计方法,希望对读者有
1.器件靠近管脚放置,反馈的电容靠近引脚放置2.铜皮要覆盖到焊盘中间,不能只覆盖焊盘的一角3.过孔要打到最后一个器件后方4.主要电源需要加宽走线保持接入接出线宽一致。5.走线在焊盘内应和焊盘保持宽度一致,出焊盘后在尽快加宽6.存在飞线没有连
在AD软件中如何对元器件进行对齐操作
Altium Designer走差分线出现网格是什么原因?答:如图1所示,在AD软件中走差分线出现网格主要是差分线的未耦合长度没有满足差分规则所导致的,未耦合长度指的是差分线中不满足差分间距的长度。图 1 差分走线出现网格走线当出现这种错误
AD里面的IEEE符号通常用来表示元件的某个引脚的输入或者输出的属性,便于分析电路图。如图1所示图1
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