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数据线线距不满足3w
这里差分等长间距不能大于2S
vref离数据线太近了
以上评审报告来源于凡亿教育90天高速PCB特训班作业评审
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电子工程师使用Allegro软件来进行PCB设计,在设计过程中可能会遇见需要将PCB交叉布线与原理图连接起来的问题,以此确保电路设计和物理布线是一致的,那么针对这个问题,如何操作?下面来看看吧!1、打开Allegro打开Allegro软件,
答:设计时,如果有铜皮叠在一起,如图6-248示;
答:一般我们在处理PCB走线的时候,都是45度走线,当遇到比较高速的信号时,为了满足阻抗的一致性,可以设置成为圆弧走线,在16.6版本以后,可以对45度的走线自动转换为圆弧的功能,具体操作如下:
答:我们在进行PCB设计的时候,都是在PCB布局完成之后,在PCB中进行规则设置,但是很多原理图工程师喜欢在原理图中设置规则,这样导入网表之后,PCB加入的规则就会被冲掉,我们这里讲解一下,如何不将原理图的中所添加的规则导入到PCB中,具体操作的步骤如下所示:
答:一般我们会在Allegro软件中指定这几个与封装库有关的路径。第一步,点击Allegro软件的Setup命令的最后一项User Preferences...,如图4-25所示; 图4-25 用户参数设置示意图第二步,在弹出的对话框中,选择Library中的devpath、padpath、psmpath三项设置路径,如图4-26所示; 图4-26 封装库路径指定示意图Ø Devpath:第三方网表(Other方式导出的网表)导入PCB时须设
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