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差分对内等长不符号规范
差分包地不完整,建议外侧也包地
差分走线长距离耦合
以上评审报告来源于凡亿教育90天高速PCB特训班作业评审
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https://item.taobao.com/item.htm?spm=a1z10.1-c-s.w21136784-21870440400.21.5c7b5284NnAAq6&id=601258730169
机壳地与电路地之间至少满足2MM间距:GND铜皮跟GND焊盘并未连接:需要设置铜皮属性之后再去重新灌铜:跨接器件两边的地可以多放置地过孔:晶振底部不要走线:TX RX直接用GND走线隔开:信号线不要从电阻电容内部走线,更改下路径:以上评审报
Altium Designer 21全新功能差分线调节Altium Designer 21对差分线的优化不可谓不大,不同于之前版本修线时不小心修动了差分线之后,阻抗间距就立即发生了变化,重新调整间距极其麻烦,基本上只能删除重画,21版本完美
差分连接焊盘走线不要重叠、锐角,两边保持一致变压器除差分走线以外其他所有走线加粗到20mil以上差分走线尽量耦合差分走线出焊盘尽快耦合保持长度一致时钟信号包地打孔处理rx、tx分别建立等长组控制100mil误差分别等长走线应连接到焊盘中心,
跨接处两边地多打过孔晶振包地约80mil距离打一个过孔过孔不要上焊盘,过孔间距太近电源走线出焊盘后尽快加粗,出焊盘后不要长距离不加粗走线以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助
AD怎么显示与隐藏原理图库的管脚编号
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