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90天全能特训班20期-Candence16.6-Hello-第三次作业-百兆网口pcb

PCB百晓通

2023-10-25 18:10

621

1.布局、布线未完成，多处电源信号、时钟信号等重要信号未布局。

2.差分对内等长错误

3.内层负片没有铜皮，地和电源网络都没有连接

4.以太网芯片到CPU的GMII接口线的发送部分需要等长，建立rx、tx分别等长控制100mil误差范围

以上评审报告来源于凡亿教育90天高速PCB特训班作业评审

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【Allegro软件PCB设计120问解析】第59问如何去删除、复制修整好的铜皮避让区域呢？

答：我们这里所说的铜皮避让区域，一般指的是手动去对铜皮进行修整过的地方。在处理相同模块的时候，这个手动进行调整过的地方是可以进行复制的，这里讲解一下，如何对修整好的铜皮避让区域进行复制以及其它操作，具体如下：

电路之家

2021-03-27 15:12

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【Allegro软件PCB设计120问解析】第57问如何去精准的定位Out of data shape呢？

答：我们在设计完成之后，需要对所有的铜皮进行smooth处理，在进行smooth处理的时候，有时因为铺铜的错误操作，出现有一块或者几块铜皮不能更新，出现Out of data shape的问题，如图6-188所示，

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2021-03-27 15:09

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【Allegro软件PCB设计120问解析】第56问怎么设置让铜皮不显示，但是显示铜皮的边界外框呢？

答：在Allegro软件中，所铺的铜皮全部都是动态铜皮，在进行Etch显示的时候，包括走线、铜皮都会显示，在前面的问答中我们讲解了如何将铜皮全隐藏不显示，但是，这样不方便走线设计，走线时不清楚哪一块有铜皮，这里我们讲解一下，如何设置铜皮不显示，但是在PCB中还是显示铜皮的边框，具体操作如下所示：

电路之家

2021-03-27 15:07

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