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1.存在飞线没有链接,几处电源走线没连
2.rx、tx两组差分对之间的间距至少4w以上
3.差分没有对内,需要等长误差5mil。
以上评审报告来源于凡亿教育90天高速PCB特训班作业评审
如需了解PCB特训班课程可以访问链接或扫码联系助教:
https://item.taobao.com/item.htm?spm=a1z10.1-c-s.w21136784-21870440400.21.5c7b5284NnAAq6&id=601258730169
注意数据线之间等长需要满足3W间距,后期自己检查一下其他组是否满足2.注意模拟信号尽量一字型布局3.跨接间距最少要保证1.5mm,一般建议2mm,有器件的地方可以不满足4.电源输出打孔要打在最后一个电容后面5.反馈信号需要走10mil的线进
答:对于PCB上某些DRC,是可以忽略,可以通过Waive DRC将此DRC隐藏。第一步,在Find选项卡中勾选DRC errors;第二步,然后将光标移动到DRC附近,右击选择Waive DRC,如图5-202所示;
注意过孔不要上焊盘2.铜皮尽量钝角,不要有尖角3.座子尽量靠近板框放置4.自己加宽一下铜皮宽度以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教:https://item.taobao
一个学习信号完整性的layout工程师在刚开始接触PCB设计时,使用的是Allegro软件。在进行第一个板子设计时就遇到了这个布局的问题。导入网表之后,发现有好多的模块是相同的。因为刚开始不知道Allegro有模块复用的功能,所以就一点一点
答:按照第5.22问的方法,进入整板的参数设置界面之后,在Display右边选中第二项,就是Design面板,如图5-52所示,在这个Design面板,对设计的一些参数进行设置,具体每一个命令详细的含义,如下所示:
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