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低八位等长超出范围
高八位也超出范围
地址线也不等长
这里走线不满足3w
布线未完成
以上评审报告来源于凡亿教育90天高速PCB特训班作业评审
如需了解PCB特训班课程可以访问链接或扫码联系助教:
https://item.taobao.com/item.htm?spm=a1z10.1-c-s.w21136784-21870440400.21.5c7b5284NnAAq6&id=601258730169
AD19 原理图复制出现“Invalid Parameter ..”报错
铜皮优化不当,不美观,尽量不要有任意角度2.反馈从滤波电容后面取样,走一根10mil的线即可3.焊盘出线不规范,焊盘中心出线至外部才能拐线处理,避免生产出现虚焊4.注意器件摆放不要遮住一脚标识5.铺铜尽量把焊盘包裹起来,容易造成开路6.电源
差分对内等长凸起捣鼓不能超过线距的两倍2.差分出线可以在优化一下3.此处走线可以从焊盘拉出后子啊进行加粗处理4.差分对内等长误差5mil时钟信号需要单根包地处理,或者离其他信号20mil以上评审报告来源于凡亿教育90天高速PCB特训班作业评
AD如何在原理图库中直接分配器件的PCB封装
晶振注意包地:缝合孔不需要打太密集,间距150mil放置一个即可:过孔不要打在焊盘上,自己注意调整:多处存在这样的情况,自己更改。铺上铜皮就不用走线了:走线不能在器件内部:晶振是需要保持净空的,不能走线:以上评审报告来源于凡亿教育90天高速
哥只是个传说,不要迷恋哥!
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