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走线未完全连接上
TX等长误差100mil,时钟信号也要进行等长
走线不要有直角
其他没什么问题
以上评审报告来源于凡亿教育90天高速PCB特训班作业评审
如需了解PCB特训班课程可以访问链接或扫码联系助教:
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在设计PCB的时候,为了满足各项设计要求的原因,我们需要设置很多的约束规则,然后设计完成之后,去进行DRC检查。DRC检查就是检查我们的PCB设计是否满足所设置的规则,常见的DRC检查有开路,短路,间距等等规则约束。
管脚要拉出焊盘在加粗,在焊盘内宽度不要超过焊盘。
还存在多处开路报错:看下此处是什么元素跟元素的间距报错:检查了对应自己修改。电感底部不要放置器件 ,净空,自己重新布局下:并且电感内部挖空处理:看下此处VCCIO线宽是否满足其载流大小:处理下多余线头删除,连接到过孔中心:走线不要出现直角:
在AD软件中我们经常会遇到一些接触的连接,但是DRC检查开断路的时候是查不出来的,但是往往这个接触不良的连接会使后期生产出来的板出现开路的现象。
器件在PCB内还存在报错 ,到封装库里面看下此封装是否焊盘上还存在其他东西,删除掉重新导入即可:整板的铜皮注意,不要尖角以及直角,都钝角铺铜:多处需要修整。还存在飞线没有连接:注意布局 是优先电路主干道的器件 其他的配置电阻电容可以远一点放
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