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1.232的升压电容走线需要加粗2.走线尽量不要从小电阻电容中间穿线,容易造成短路3.USB走线不满足差分间距规则,可以打孔4.焊盘出线需要优化一下,拉出焊盘在进行加粗5.晶振需要包地处理,其他信号线不要从晶振里面穿6.USB差分对内等长5

90天全能特训班18期 AD --iYUN-STM32

1.注意差分走线要满足差分间距规则这个电源尽量在电源层处理,增大走线宽度线尽量走直线,不勾等长的在后边进绕蛇形电容靠近管脚摆放,一个管脚一个以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联

90天全能特训班20期 AD -孔傲涵-HDMI

1.和外壳地连接这里需要多打孔2.过孔上小器件焊盘3.走线不满足3w间距规则以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教:https://item.taobao.com/item

90天全能特训班20期-AD_千兆网口

1.差分换层在旁边需要打回流地过孔2.差分对需要对内等长,差分出焊盘应尽快耦合3.信号线需要保持3w间距规则4.存在开路没有连接以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教:ht

90天全能特训班20期-AD_二十好几的第四次作业百兆

跨接器件旁边尽量多打地过孔2.差分走线不满足间距规则3.差分走线可以在优化一下4.线宽尽量保持一致5.注意过孔不要上焊盘,器件摆放不要干涉6.PHY芯片中间焊盘上的过孔需要开窗处理以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需

90天全能特训班20期 AD -段太-千兆网口

差分走线有待优化,这些直角锐角都需要调一下间距规则的报错需要处理一下包地要包全

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PCB Layout 2023-10-23 17:23:41
AD--John USC3.0&TPYE-C 作业评审

线宽不一致,导致阻抗不连续走线需要保持3w间距规则地址线分组错误,缺少信号时钟线等长错误电源走线多处没有加粗数据线等长误差控制100mil范围内以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫

90天全能特训班20期-ad-邹旭 SDRAM模块

1.电源模块主输出路径打孔只有两个孔有连接,载流不够2.差分有报错未处理3.LED灯尽量考经板边摆放4.pcb下方各模块电源走线载流不够,应最少40mil线宽5.信号布线注意保持3W间距规则6.布线尽量避免直角锐角以上评审报告来源于凡亿教育

90天全能特训班20期-AD_2层STM32

差分走线要注意耦合出线2.时钟信号包地需要再地线上打上地过孔3.差分走线不满足间距规则4.网口差分需要进行对内等长,误差5mil5.小块孤铜后期可以挖掉以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问

90天全能特训班20期 AD -xiaohao-百兆网口

进行PCB设计时需要养成良好的设计习惯,才能保证后期的生产效果。例如整板上需要保证丝印跟阻焊的间距规则避免产生丝印重叠造成的PCB制造设计(DFM)问题。丝印重叠阻焊的影响有如下:1)PCB板后期打样,一般是以阻焊层优先,如果丝印跟焊盘重叠

Atium Designer 23 全新功能-丝印制备,解决DFM问题