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1.485需要走内差分2.网口除差分信号外,其他的都需要加粗到20mil3.差分对内等长5mil4.跨接器件 旁边尽量多打地过孔,分割间距尽量1mm以上5.模拟信号走线需要加粗6.电感所在层的内部需要挖空处理7.电源输入滤波电容法尽量靠近管

90天全能特训班18期 AD --李侠鑫-达芬奇

电源输出应该从滤波电容后面进行输出打孔2.电源输入主干道尽量铺铜处理,满足载流。此处要先经过电容在输入到电感3.输出滤波电容应该放置在主干道上,先大后小4.反馈信号需要从最后一个滤波电容后面取样,走一根10mil的线5.此处走线需要再优化一

90天全能特训班18期 allegro -常密生 -DCDC

1.485走内差分需要再优化一下2.跨接器件旁边尽量多打地过孔,间距最少1mm3.网口差分对内等长误差5mil4.模拟信号走线需要加粗5.电感所在层的内部需要挖空处理6.反馈从电容后面取样,走10,mil7.输入打孔要打在滤波电容前面8.注

90天全能特训班18期 AD -李天昊 -达芬奇

电感所在层的内部需要挖空2.注意过孔不要上焊盘3.铺铜尽量包住焊盘,避免造成开路4.反馈要从最后一个滤波电容后面取样5.此处不满足载流,建议铺铜处理,走线不要有锐角6.电感下面尽量不要放置器件,可以放在芯片管脚上7.器件干涉8.走线与焊盘同

90天全能特训班19期 AD -朱腾 -DCDC

电感中间挖空后要选中铜皮重铺才可以2.注意过孔不要上焊盘3.存在开路,后期自己优化一下走线4.滤波电容靠近管脚放置,优先放置,注意出线载流瓶颈,加宽铜皮5.注意电感底部不要放置器件以及走线,需要重新优化下底层的布局以及布线:6.器件干涉7.

90天全能特训班19期 AD - 张冰-PMU

存在多处开路2.打孔需要打在输出滤波电容后面,在底层铺铜进行连接3.反馈线宽走10mil即可4.在底层铺一块整版地铜进行连接以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教:http

90天全能特训班19期 allegro - 黎润舟-DCDC

此处不满足载流2.此处存在开路3.输出打孔要打在滤波电容后面5.反馈线要从滤波电容后面取样,走10mil即可6.电感所在层的内部需要挖空处理,背面尽量不要放置器件7.电源网络需要再底层铺铜进行处理,剩下的地方铺地以上评审报告来源于凡亿教育9

90天全能特训班19期 allegro - 杨喵喵-PMU

此处的电阻电容塞到芯片底部,跟对应网络进行连接:机壳地跟电路地之间至少间距2MM,除了 跨接器件部分:变压器每层都需要挖空:变压器上除了差分其他信号加粗到20MIL:晶振注意从滤波电容那里包地处理:一把RX 或者TX的信号线尽量是一把紧凑整

全能19期-黎润舟-第四次作业-千兆网络模块设计

1.电源滤波电容尽量靠近管脚摆放均匀放置,尽量一个电源焊盘放一个电容2.器件摆放干涉3.地址线分组错误,缺少部分信号4.信号线布线造成闭合回路。5.顶层低层没有铺铜,导致地焊盘没有连接过孔。6.时钟没有和地址线等长以上评审报告来源于凡亿教育

90天全能特训班19期 张冰+第六次作业+1片SDRAM模块的PCB设计

差分走线要耦合出线2.差分对内等长凸起高度不能超过线距的两倍3.器件摆放干涉,后期自己调整一下放底层4.器件摆放太近5.滤波电容尽量保证一个管脚一个,原理图不够可以自己添加6.过孔不要上焊盘7.差分出线要尽量耦合以上评审报告来源于凡亿教育9

90天全能特训班19期 allegro - Faker-2DDR