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多处走线没有网络造成报错多处网络未布线,反馈信号打孔链接到电路最后一个器件相邻电路大电感应朝不同方向垂直放置焊盘尽量避免从长边和四角出线以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助

90天全能特训班22期-莱布尼兹的手稿 第二次作业 DCDC

差分需要按照阻抗线宽走2.跨接器件旁边要多打地过孔,间距建议2mm,有器件的地方可以不满足3.变压器需要所有层挖空处理4.网口除差分信号外,其他的都需要加粗到20mil,尽量单独打孔,器件靠近管脚摆放5.差分信号焊盘出线需要在优化一下6.晶

90天全能特训班22期AD-冯定文-千兆网口

跨接器件旁边要多打地过孔2.焊盘出线需要优化一下3.晶振需要走类差分4.确认一下此处是否满足载流5.TX和RX中间尽量添加一根地线进行分隔6.焊盘需要开窗处理,后期没法进行上锡焊接以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需

90天全能特训班22期AD-小白-千兆网口

外壳地和GND铜皮间隔2mm以上间距rx等长组缺少两个网络焊盘尽量避免从长边和四角出线以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教:https://item.taobao.com

90天全能特训班22期-AD-杨正灿-千兆模块作业

网口差分需要进行对内等长,误差5mil2.走线需要优化一下,尽量不要出现直角3.差分出线要尽量耦合4.差分焊盘出线尽量从四角出线,后期自己优化一下5.差分需要按照阻抗线宽线距走线,避免后期造成阻抗突变6.存在多处drc7.时钟信号包地,尽量

90天全能特训班22期AD-hermit-百兆网口

注意焊盘出线规范后期自己优化一下2.差分对内等长凸起高度不能超过线距的两倍3.注意差分走线要尽量耦合4.一层连接不用打孔,注意不要出现STUB线头5.CC1和CC2属于重要信号,走线需要加粗6.注意差分信号包地要在地线上打上地过孔7.过孔需

90天全能特训班22期AD-焦彦芸-USB3.0

USB2.0:差分走线是需要保持耦合,需要修改,不合格:USB3.0:还有一块铜皮存在板外,自己删除下:此处器件注意整体中心对齐放置:差分信号打孔换层的过孔两侧打上地过孔:此处差分需要优化,要耦合走线 :注意此处焊盘出线,需要从两侧边拉线出

Allegro-全能22期-莱布尼兹的手稿 第五次作业 USB2.0 USB3.0 TPYE-C

走线注意保持3w间距c+c-v+v-,所接电容属于升压电容,走线注意加粗到10mil及以上差分换层在旁边打回流地过孔SD模块数据线整组包地打孔处理地网络焊盘就近打孔晶振打孔包地走线尽量避免直角锐角焊盘避免从长边、四角出线以上评审报告来源于凡

90天全能特训班22期-曾稳龙—第六次作业2层STM最小系统

多处存在开路报错焊盘应从短边出线,避免从长边和四角出线ddr和芯片放置太近,导致没有足够空间绕线,绕线很乱走线不能从同层器件中间穿过时钟线等长错误以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或

90天全能特训班22期-David AD - 第5次作业 -一片SDRAM模块

焊盘出线需要优化一下2.铜皮需要优化一下,尽量不要直角,建议45度3.差分走线需要耦合,后期自己调整一下4.差分对内等长误差5mil所有差分对都要注意一下5.负片层需要指定网络进行连接6.差分走线需要按照阻抗线宽线距进行走线,避免发生阻抗突

90天全能特训班22期AD-冯定文-USB3.0