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电源信号都没有处理：注意等长线的GAP尽量满足大于等于3W长度：可以减少串扰。注意看下xsignals分组 U16 -U17没有信号：数据跟地址用GND走线隔开：此处电源可以在电源层分割：以上评审报告来源于凡亿教育90天高速PCB特训班作业
差分走线要耦合出线2.差分对内等长凸起高度不能超过线距的两倍3.器件摆放干涉，后期自己调整一下放底层4.器件摆放太近5.滤波电容尽量保证一个管脚一个，原理图不够可以自己添加6.过孔不要上焊盘7.差分出线要尽量耦合以上评审报告来源于凡亿教育9
注意数据线之间等长需要满足3W2.串组两端的信号也要加入地址信号进行等长3.地址线和数据线之间需要画一根地线进行分开4.电源需要再电源平面层进行处理，打孔进行连接以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课
差分线可以在优化一下2.晶振走内差分，且包地处理，并在地线上打过孔3.注意等长线之间需要满足3W4.网口除差分信号外，其他的都需要加粗到20mil5.存在一处开路报错以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训
差分对内等长凸起高度不能超过线距的两倍2.差分出线要尽量耦合3.TX和RX要创建等长组进行等长4.确认一下此处是否满足载流，加粗线宽以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教：
电源输出打孔要打在电容后面2.反馈信号要走10mil3.等长存在误差报错4.差分走要满足差分间距要求，等长原则是哪里不耦合，就在哪里进行等长5.VREF线宽最少要加粗到15mil以上6.注意器件摆放不要干涉以上评审报告来源于凡亿教育90天高
注意绕蛇形不要有直角2.差分线等长凸起高度不能超过线距的两倍3.存在多余的走线4.过孔不要上焊盘5.VREF的电源信号走线最少要加粗到15mil以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫
控制信号走线可以不用加粗，注意线宽尽量保持一致2.输出打孔要尽量打在滤波电容后面3.电源要在底层蒲婷进行处理4.此处电源不满足载流以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教：h
注意数据线之间等长需要满足3W2.次根信号等长不满足原理图要求3..地址线之间等长也需要满足3W4.存在开路以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教：https://item
时钟信号等长不符合要求2.器件摆放注意间距，一般建议1.5mm3.器件摆放注意干涉4.此处等长需要优化一下其他没什么问题以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教：https:
