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地址线分组,CLK,CKE0都要添加进来一起进行等长
2.数据线分组应该是一组9根
2SDRAM
注意规则设置,导致等长有黄色提示
2.注意过孔需要盖油处理
其他没什么问题
以上评审报告来源于凡亿教育90天高速PCB特训班作业评审
如需了解PCB特训班课程可以访问链接或扫码联系助教:
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在AD中怎么显示与隐藏原理图库的网络名字
器件干涉2.地网络就近打孔,缩短回流路劲3.差分对内等长凸起高度不能超过线距的两倍4.差分走要耦合,且满足差分间距要求5.注意走线不要有直角,后期自己优化一下6.VREF的线宽最少要加粗到15mil以上7.差分对内等长误差5mil8.反馈线
模拟信号下面不要走线其他信号线2.晶振走线内差分需要再优化一下3.跨接器件旁边尽量多打地过孔,间距最少1mm4.差分走线不满足间距规则5.网口两队差分需要控100欧姆,要添加class,进行等长,误差5mil6.电感所在层需要挖空处理7.注
集成库创建完成后,如何对创建好的集成库进行调用呢?这时就涉及集成库的安装使用了。第一步:如图2-36所示,单击右侧上角面板栏中的“”,如图1所示。图1第二步:对于“Data Management-Installed Libraries”选项
为了尽量减小单板设计的串扰问题,PCB设计完成之后一般要对线间距3W规则进行一次规则检查。一般的处理方法是直接设置线与线的间距规则,但是这种方法的一个弊端是差分线间距(间距设置大小不满足3W规则的设置)也会DRC报错,产生很多DRC报告,难以分辨
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