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90天全能特训班15期allegro-谢一汉-达芬奇-作业评审

PCB鬼才
2023-03-24 17:16
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  1. 晶振走内差分需要再优化一下

image.png

2.模拟信号走一字型布局，没空间就调整旁边的器件和走线

image.png

3.跨接器件旁边尽量多打地过孔，间距建议2mm，贴片器件建议离定位孔远一下

image.png

可以参考一下此图

image.png

4.地址线，控制线和时钟信号未创建等长组进行等长

image.png

image.png

5.此处走线能拉直尽量拉直

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6.这把数据线应该先从BGA到IC在到SDRAM，后期自己优化一下

image.png

以上评审报告来源于凡亿教育90天高速PCB特训班作业评审

如需了解PCB特训班课程可以访问链接或扫码联系助教：

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1.器件重叠，焊盘重叠会导致器件无法焊接。2.底层没有铺铜处理3.过孔应打到走线最后一段，完全包围走线。以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教：https://item.t

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这个vref是参考电压，写入或读取数据时需要用vref来确定是高电平还是低电平，不要大面积铺铜。四块的也是一样ddr到芯片的距离有点远了一般是600-800mil丝印位置可以调一下，调整齐不放焊盘上其他的没什么问题以上评审报告来源于凡亿教育

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差分对内等长凸起高度不能超过线距的两倍2.地网络尽量在地平面层铺铜进行处理3.TX和RX需要创建等长组进行等长4.注意器件摆放不要干涉5.注意电源要尽量满足载流，线宽保持一致以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解P

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此处电源走线要注意满足载流2.晶振需要走内差分，并包地处理3.器件摆放不要挡住一脚标识4.注意等长线之间需要满足3W5.注意电源要满足载流6.变压器要所有层挖空处理以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班

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个别器件注意整体对齐：注意等长线之间需要满足3W间距原则：没满足的都自己优化下。数据线组内也需要满足3W：差分对内等长误差为5MIL：其他的没什么问题。以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问

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