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485信号线应按加粗类差分处理，走线最少加粗到8mil以上232的C+C- V+V-所接电容属于升压电容，走线按电源走线加粗tx、rx信号走线用gnd打孔隔开以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程
在PCB布局布线过程中，工程师经常面临着走线宽度变化的问题，由于布线空间的限制，可能会使用更新或更粗的线条来通过某些区域，但这种变化会导致阻抗不匹配，最终信号反射，对整体电路产生负面影响，因此会有哪些问题？一般来说，走线宽度会导致阻抗不匹配
ddr之间ddr和芯片距离太远，ddr到芯片推荐600-800mil器件摆放太近丝印干涉，滤波电容推荐摆放到ddr背面靠近焊盘放置 过孔上焊盘，小器件焊盘尽量不要打孔到焊盘上差分线是主要时钟信号，尽量缩短走线电容靠近ddr中间放置差分线等长
焊盘从短方向出线，不要从长方向和四角出线，从焊盘中心出焊盘后拐弯主电源输出打孔要在模块最后一个电容后方，多打孔加大载流 SD走线保持3w间距整组打孔包地usb差分对经过电阻后而然是差分对，按照差分布线尽量耦合减短换层走线长度，换层打孔旁边打
AD软件提供了比较智能的走线模式切换功能，可以根据个人习惯进行切换，能有效的提高了PCB设计效率。点击界面右上角系统参数的图标或者在pcb界面中使用快捷键OP进入到优选项界面，然后选中 PCB Editor-Interactive Rout
注意电容输入需要按照先大后小进行摆放2.电感所在层的内部需要挖空处理3.存在多处开路4.模块复用后需要自己对铜皮赋予网络，重新铺铜，否则会存在无网络铜皮，造成开路5.走线需要连接到焊盘中心6.除了散热过孔，其他的都需要盖油处理7.后期需要在
电感底部不要放置器件，优化下布局：电感内部的铜皮需要挖掉：信号走线不能从电阻电容内部穿过，优化下走线路径：整体需要特别处理的就是电感底部的电容，不能放在电感底部，需要优化布局。其他的DCDC以及LDO没什么问题。以上评审报告来源于凡亿教育9
多处飞线没有连接铺铜尽量用动态铜皮电源输出路径铺铜加宽载流，按原理图顺序放置封装反馈路径应连接到电路最后端，走线即可主输出和反馈信号正确示范一路dcdc电路地信号连接通，在芯片下方打孔接地相邻电路电感应朝不同方向垂直放置问题很多，需要认真改
焊盘避免从长边、四角出线大电感下方同层铺铜挖空相邻电路大电感应朝不同方向垂直放置走线铺铜避免直角锐角以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教：https://item.tao
注意走线规范，不允许直角走线，并且地网络尽量铺铜处理：注意 铜皮绘制不要有尖角：器件注意整体中心对齐：铺铜的铜皮宽度尽量均匀：多余的过孔删掉：焊盘出线不能直接拉出，需要拉出焊盘之后再去拐线处理：整板的走线跟铜皮以及布局都要优化。以上评审报告
