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答：我们在进行PCB设计的时候，都是在PCB布局完成之后，在PCB中进行规则设置，但是很多原理图工程师喜欢在原理图中设置规则，这样导入网表之后，PCB加入的规则就会被冲掉，我们这里讲解一下，如何不将原理图的中所添加的规则导入到PCB中，具体操作的步骤如下所示：
答：我们在PCB设计过程中，差分信号是比较重要的信号，一般设置差分信号到其它信号的间距是20mil，但是设置完差分信号到其它信号的间距之后，差分对内PN之间不满足20mil的间距，会报错，如图6-205所示：
答：第一步，点击Shape-Select Shape or Void/Cavity选项，如图6-222所示；
答：首先，点击Setup-Design Parameter Editor命令，在Display选项卡中，勾选Via Lables选项，点击OK退出，如图6-254所示；
答：设计PCB过程中，若设计中有差分对信号，则需要将是差分的2个信号设置为差分对，设置差分对有2种方式：手动添加及自动添加。
答：在Allegro PCB中，会经常切换走线线宽，一般Allegro PCB默认是记忆走线线宽的，即走完一个信号在连接一个新的网络线时，软件会默认使用连接上一个网络所使用的线宽。可以通过设置，让软件不执行自动记忆上一次走线宽度。
答：我们在PCB设计中经常听到需要漏铜处理，或者是这里我要铺白油，这在PCB板上非常好理解，生产出来黄色的就是铜，白色一块的就是白油。我们这里讲解一下，在Allegro软件中如何处理，具体操作如下所示：
答：我们在PCB设计时，都会进行规则的设置，然后使用规则来约束设计，进行DRC的监测。我们这里讲解一下，soldemask也就是阻焊到其它元素的间距应该如何设置呢，具体操作的方法如下所示：
答：我们在PCB设计中，经常会遇到一些异形的板框，比如做FPC设计、LED灯板设计，如图6-286所示，我们PCB走线都是按45度走线，直接去走，很能走的规范，到板边的间距是一致的，这里讲解一下，如何设置一下，让走线沿着PCB板框按一定的规律进行布线，具体操作如下所示：
答：一般在使用Allegro软件设计时，铺铜都会铺实铜，但是对于如FPC设计，通常需要铺网格铜，以满足PCB的弯折性要求。具体操作的步骤如下所示：第一步，首先使用Shape-Polygen选项，在PCB上画一个铜皮，此时画出来的铜皮是实心的，如图6-297所示；
