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1、存在开路和短路。2、地址线的等长是ic到ddr的长度。3、时钟线布线错误,应该从u16到r46再到u1。4、时钟线等长错误,是SDRAM段到电阻和电阻段ic的线一样长。以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PC

黄玉章-AD第四次作业-SDR模块作业评审

1.焊盘应该从宽方向出线 ,避免从长方向出线2.反馈路线应该远离干扰原,建议走底层远离电感。3.过孔上焊盘,同网络过孔也要保持一定间距。4.反馈信号不能从其他器件下穿过。5.不能这样打孔接地,要做到单点接地。以上评审报告来源于凡亿教育90天

DCDC电源模块第一次作业评审

跨接电容旁边进行多打地过孔,不同的地间距建议2mm2.器件干涉3.SDRAM等长还存在没有达到目标值4.走线尽量不要从电阻电容中间穿5.滤波电容应该靠近输入管脚放置以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班

90天全能特训班15期 AD-lzhong-达芬奇-作业评审

1.485需要走内差分处理2.模拟信号需要单根包地,一字型布局3.晶振走内差分需要优化一下4.跨接器件旁边尽量多打地过孔,不同的地间距建议2mm 5.除差分外,其他信号都需要加粗到20mil6.网口差分对内等长误差5mil7.模拟信号单根包

90天全能特训班16期 AD-李文贵-达芬奇-作业评审

添加的地线尽量多打地过孔2.数据线一组尽量走一起,中间不要有地址线3.此处网络需要加入class一起进行等长4.电源需要处理一下,器件摆放尽量中心对齐以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问

90天全能特训班17期 AD-蒋冠东 -1SDRAM-作业评审

走线未连接到过孔中心2.器件干涉3.时钟信号等长不符合规范4.滤波电容尽量靠近管脚摆放,尽量一个管脚一个5.直接在电源层铺一个整版电源即可以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系

90天全能特训班17期 AD-花生果汁 -1SDRAM-作业评审

差分锯齿状等长不能超过线距的两倍2.注意过孔不要放置过孔上3.T点打孔尽量对齐4.D1未添加pin pair进行等长,存在报错5.地址线也存在报错6.后期自己在电源层和地层铺铜进行连接以上评审报告来源于凡亿教育90天高速PCB特训班作业评审

90天全能特训班17期 allegro-马晓轩 -2SDRAM-作业评审

数据线一组只有9根线,其他信号不要添加进来,高八位少一根LDQM12.数据线和地址线建议添加一根最少20mil的地线进行隔开3.过孔里存在多余的线头4.地址线分组错误,有电阻几根网络也需要添加进来进行一起等长,还有时钟信号5.走线需要从焊盘

90天全能特训班17期AD-Amusing-1SDRAM-作业评审

1.485需要走内差分处理2.跨接器件旁边尽量多打地过孔,间距建议2mm3.晶振下面尽量不要走线4.差分走线不满足间距规则以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教:https

90天全能特训班16期AD-Dong-达芬奇-作业评审

跨接器件旁边尽量多打地过孔2.此处为电源网络,线宽需要加粗3.确认一下此处是否满足载流,线宽尽量一致4.晶振下面不要走线5.差差分之外,其他的信号都需要加粗到20mil6.器件摆放不要挡住1脚标识7.注意等长线之间需要满足3W规则,与时钟信

90天全能特训班17期pads- CZS-千兆网口-作业评审