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器件摆放尽量中心对齐，后期自己优化一下2.采用单点接地，只用在芯片中心打孔，其他地方不用打孔3.存在飞线未处理后期自己在底层铺铜把地网络进行连接4.反馈信号尽量远离电感，走线走10mil即可以上评审报告来源于凡亿教育90天高速PCB特训班作
USB2.0：差分走线是需要保持耦合，需要修改，不合格：USB3.0:还有一块铜皮存在板外，自己删除下：此处器件注意整体中心对齐放置：差分信号打孔换层的过孔两侧打上地过孔：此处差分需要优化，要耦合走线 ：注意此处焊盘出线，需要从两侧边拉线出
电源网络DP3V3全都是飞线显示，内层存在电源层赋予对应网络即可：电源平面层没有赋予网络，导致存在飞线网络没有连接：焊盘扇孔注意对齐，都没对齐，需要修改：类似这种过孔内存在线头的自己删除：注意走线优化：地址线内还存在误差报错：不需要拉线的地
器件丝印要么重叠，要么就覆盖在焊盘上，都调整下器件丝印：上述一致原因：电池信号走线需要加粗：软件内多处存在此孤铜没有割除：晶振底部净空，不要有走线：上述一致原因： 打孔尽量打对齐：过孔不要打在焊盘上：以上评审报告来源于凡亿教育90天高速PC
采用单点接地，只用在芯片中间打孔进行回流，其他地方不用打孔2.铺铜和走线选择一种即可3.打孔区域尽量避开焊盘，并且铺铜要包裹住焊盘器件摆放尽量中心对齐处理焊盘出线不规范，焊盘中心出线至外部才能拐线处理，避免生产出现虚焊散热过孔需要开窗处理器
此处电源网络底层已经铺铜连接，顶层无需再进行铺铜，并且走线宽度完全满足不了载流；建议顶层能铺铜的就尽量一层布线不用到底层铺铜连接：铺铜注意不要直角以及尖岬角，尽量都钝角，板上多处铜皮类似情况，自己优化：器件布局注意中心对齐，调整下：上述一致
电源也没连接，地也没连接，信号也没连接：建议设计完成之后再把文件提交评审。注意铜皮尽量不要直角，尽量钝角铺铜：存在类似问题的都自己优化下。电源输入部分的器件靠近IC输入管脚布局，不要太远，整个路径都是要尽量短的：器件建议整体中心对齐：走线不
此处不满足载流，后期自己加粗一下线宽或者铺铜处理2.反馈线宽尽量保持一致，加粗到10mil3.存在开路，后期自己处理一下电源和地的飞线电感下面尽量不要放置器件注意不要重复打孔，打孔尽量对齐处理以上评审报告来源于凡亿教育90天高速PCB特训班
下方电路多余铜皮修掉尽量单点接地，把gnd焊盘连接到一起只在芯片下方打孔器件布局太乱，相邻器件朝一个方向放置中心对齐反馈信号走线8-10mil就可以 电路主输出路径加大载流，这里铜皮加宽以上评审报告来源于凡亿教育90天高速PCB特训班作业评
4、结构体成员的布局很多编译器有“使结构体字，双字或四字对齐”的选项。但是，还是需要改善结构体成员的对齐，有些编译器可能分配给结构体成员空间的顺序与他们声明的不同。但是，有些编译器并不提供这些功能，或者效果不好。所以，要在付出最少代价的情况下实现最好的结构体和结构体成员对齐，建议采取下列方法：(1)
