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答：在第5.35问中，我们讲述了直接添加的办法去添加相对传输延迟的等长规则。这一问呢，我们讲述一下如何使用模型添加法去添加相对传输延迟的等长规则，具体的操作步骤如下所示：第一步，打开规则管理器，执行菜单命令Setup-ConstRAints，在下拉菜单中选择ConstRAint Manager，如图5-99所示，进入到规则管理器中；
答：在前面的问答中我们讲解了Team Design功能的详细使用方法，除了这种方法可以进行协同设计以外，这样是最高效的方法，Sub-dRAwing功能也是可以的，简单的说，Sub-dRAwing就是从别的PCB文件拷贝器件或者走线到当前的PCB文件中，而copy命令也是复制功能，但是只能应用于同一个PCB文件中，这个是二者最大的区别，以下我们讲解一下，Sub-dRAwing功能的具体的应用方法，操作如下：
答：我们在PCB设计过程中，之前是使用的小的过孔，后面需要替换成大的过孔，一个一个去替换过孔非常麻烦的，这里，我们讲解一下如何去整体的替换过孔，具体的操作方法如下所示：第一步，在PCB界面选择设计模式，选择GeneRAl Edit模式，如图5-172所示；
答：在PCB布线完成之后，一般会对走线添加泪滴，目的是为了增加线与过孔的和焊盘的连接强度，提高可制造性，这里，我们讲解一下，在Allegro软件中如何对走线添加泪滴操作，具体如下所示：第一步，需要设置好参数，点击执行菜单命令Route-Gloss，在下拉菜单中选择PaRAmeters，进行参数设置，如图5-177所示；
答：正常情况下CM规则管理器中属性较多，有很多列，如果有部分列我们不想显示，则可以隐藏，具体操作的步骤如下所示：第一步，点击Setup-ConstRAints-ConstRAint Manager选项，调出规则管理器。然后找到想隐藏的属性列（如Max Length），然后右击点击Hide Column选项，如图5-196所示，即可隐藏此列内容；
答：在做PCB设计时，常会需要从PCB中提取封装出来，用到现有的设计中，一般我们直接可以在PCB中导出封装到指定的目录中，再到相应的目录中提取封装。第一步，点击File-Export-LibRAres选项，如图5-203所示；
答：在PCB设计完成后，一般需要对PCB板框的长宽尺寸进行尺寸标注，标注时可以选择双单位显示标注的尺寸。第一步，点击Manufacture-Dimension Environment选项，然后右击选择PaRAmeters选项；
答：Allegro导出封装库时，一般我们会勾选No libRAry dependencies选项，如图5-207所示：
答：飞线，是根据原理图的连接关系，导入到PCB中进行版图设计的一种指引关系，指引PCB工程师去连接不同的网络。这里介绍一下，Allegro软件中显示飞线与关闭飞线的几种方式，具体如下：首先，执行菜单命令，Display-Show RAts，是显示飞线的命令，如图6-70所示，在下拉菜单中有多个选项，我们对几个常用的命令进行介绍；
答：所谓的阵列过孔，就是在某一个区域或者走线上，按照某种特定的规律，均匀整齐的放置过孔，执行菜单命令Place-Via ArRAys，进行阵列过孔的放置，如图6-121所示，在下拉菜单中有三个选项，具体的含义如下：
