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邮件-AD-Daniel-Mian_CORE-VB作业评审

2023-03-13 17:12

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晶振需要走内差分处理

2.SDRAM数据线低八位和高八位需要分开创建class，分别进行等长

3.注意数据线之间等长需要满足3W规则

4.地址线也需要满足3W规则

5.滤波电容靠近管脚放置，尽量保证一个管脚一个

6.数据线等长误差建议+-25,mil

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确认一下此处输出是否满足载流，后期自己加宽走线2.电容尽量靠近管脚摆放，尽量均匀摆放3.走线可以在优化一下，尽量不要有锐角4.存储器要分组走线，同组同层，需要等长处理，误差100mil5.走线注意拓扑结构，这个应该是采取菊花链的走线方式，后

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走线尽量拉直，自己优化一下2.等长线之间需要满足3W3.线宽尽量保持一致4.电容摆放尽量先经过电容在进入管脚5.跨接器件旁边尽量多大地过孔SD时钟信号尽量单根包地以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课

2023-04-20 15:02

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焊盘避免从长边、四角出线大电感下方同层铺铜挖空相邻电路大电感应朝不同方向垂直放置走线铺铜避免直角锐角以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教：https://item.tao

2024-03-18 16:08

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2023-08-21 16:30:02

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