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本篇和大家一起看下我们的Altium designer 19里面如何对我的BOOM清单原理图分页进行导出。
首先我们的打开的原理图的报告,选择我们的Bill of Materials,点击进去。
然后我们在选择显示处选择我们的DocumentName勾选即可。
这样就可以单页单页的输出原理图的BOOM表了。
芯片的15、16脚是主输出管脚,应铺铜加大载流连接到Q1 分析电流流向,按照先大后小原则放置电容 Pcb缺少器件,少两个电容没有导入pcb 相邻电路电感应朝不同方向垂直放置 焊盘不要从长边出线,要从短边出线在焊盘内不要有多余线头不要拐弯
在DDR的设计中,需要对数据线及地址线进行分组及等长来满足时序匹配,通常DDR的数据线之间的长度误差需要保证在50mil以内,地址线的长度误差需要保证在100mil以内。执行菜单命令【设计】-【规则】或者使用快捷键DR打开规则约束器,在“H
器件摆放干涉,如生产会造成两个器件重叠无法焊接。部分器件摆放过于紧凑,间距大小不一不同方;建议器件对齐等间距摆放,尽量相邻器件同方向放置。J8连接器应该放到电路的输出末端,电源应该铺铜加大载流电源应该从电阻流到芯片在到连接器。焊盘应该出宽方
1.多处焊盘出线问题,焊盘中心出线至外部才能拐线处理。2.过孔没有网络3.焊盘出线尽量耦合、长度相等,存在多处相同问题。4.差分等长拱起处间距要在一倍间距到两倍间距之间。差分没有做对内等长差分走线不耦合需要加宽的走线宽度不一致多处存在开路过
差分线对内等长凸起高度不能超过线距的两倍2.存在开路3.注意差分需要进行对内等长,误差5mil4.注意等长尽量不要直角,建议钝角,后期自己优化一下5.后期自己在地平面和电源平面指定网络进行连接6.差分需要按照阻抗线距走,后期自己注意一下以上
凡亿教育打通了“人才培养+人才输送”的闭环,致力于做电子工程师的梦工厂,打造“真正有就业保障的电子工程师职业教育平台”。帮助电子人快速成长,实现升职加薪。
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