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传输速度越快,误差要求越小?DDR2的数据线等长误差范围为±25mil,那DDR3的数据线等长误差范围是多少呢?

在高速设计中,基于时序的考虑通常要对信号做线长匹配。对于Allegro PCB设计者来说,我们在等长的时候经常会提到X-NET,利用X-NET功能我们能够很快的计算多点拓扑结构等长长度,并且还能够计算数据组等长误差,很是方便,但是我发现在给很多学员教学的过程中,很多人不清楚这个功能的使用,那么我们这次抽时间弄成一个专题来详细的给大家讲解一下。

高速PCB教程之X-NET在等长设计中的应用