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老师：PCB如何复制部分模块从别人画好的layout 中

老师：PCB如何复制部分模块从别人画好的layout中

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各位大佬在cadence17.4的元器件封装绘制时我实际已经打开原点显示了，但是却没有正常显示，我坐标也弄了但是都是乱的

各位大佬在cadence17.4的元器件封装绘制时我实际已经打开原点显示了，但是却没有正常显示，我坐标也弄了但是都是乱的求解

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封装绘制乱了

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把基准电压、速度检测和电压检测的地作了单独划分，这样没问题吧？

把基准电压、速度检测和电压检测的地作了单独划分，这样没问题吧？

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速度检测基准电压电压检测

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请问一下出现这个锯齿波形是什么原因啊？

波峰比波谷大了2dbm左右正常应该是0.5以下啊经过了滤波器就这样了，前面都是好的

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我c10的1脚2脚，分别与u2的1，3脚连，一个在底层，一个在顶层，如果我把焊盘重合起来，连线的话也是打孔吗

老师，我c10的1脚2脚，分别与u2的1，3脚连，一个在底层，一个在顶层，如果我把焊盘重合起来，连线的话也是打孔吗这样子摆放，不能打在焊盘上吧，都先拉出来打是吧

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打孔PCB连线

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铺铜的话要把焊盘全部铺进去吗，怎么铺铜快速美观合适，有啥铺铜规范？

铺铜的话要把焊盘全部铺进去吗，怎么铺铜快速美观合适？感觉自己没个标准，有些地方铺的胖胖的，有些地方铺的瘦瘦的，太瘦影响载流的吧，有啥经验值吗

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铺铜规范快速铺铜

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用pads make reuse功能，复用过来为啥不一致啊，电路是类似的

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PADS中这个错误怎么取消显示的，都没错

PADS中这个错误怎么取消显示的，都没错

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错误标记取消显示

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请问老师：焊盘规则和过孔规则一样？我的过孔规则最大值3.5mm怎么还报错？

是什么原因？沒看到焊盘规则

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AD中导出BOM表，不想要这种带*的，可以吗

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BOM表导出BOM