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等长组创建有误,一组9根信号2.这些信号也需要加入到地址线的class组里面进行等长器件摆放不要干涉后期自己调整一下,尽量不要用直接建议钝角以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联

90天全能特训班 19期-AD-熊思智-1SDRAM

SATA:可以直接把差分规则里面的耦合度设置大一点就不会报错了:此处差分直接走顶层不用扇孔了:MIPI:注意差分组跟组等长误差为10MIL:此对差分对内等长误差是5MIL:以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PC

AD-全能21期-刘林-第七次作业-AUDIO,MIPI,RF,SATA,VGA模块

时钟信号等长错误数据线分组却少网络等长绕线太丑,信号流向尽量顺畅以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教:https://item.taobao.com/item.htm?s

90天全能特训班21期-刘林-第五次作业-2片SDRAM模块的PCB设计

走线需要优化,同网络的线也要保存3w差分对内不等长很多地方数据线不满足3w以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教:https://item.taobao.com/item.

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PCB Layout 2024-01-15 19:44:24
往事如烟AD-第六次作业-2片DDR的pcb设计作业评审

数据线线距不满足3w这里差分等长间距不能大于2Svref离数据线太近了以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教:https://item.taobao.com/item.ht

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PCB Layout 2024-01-15 20:18:37
 LHY——第10次作业——DDR4片FLBY结构作业评审

存在短、天线、间距报错布线要求3w间距规则等长绕线太乱,锯齿状等长尽量咬合地址线等长不达到要求误差范围时钟线等长错误电源布线注意加粗以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教:

90天全能特训班21期-喜之狼 AD20 2片SDRAM 布局

还有地网络并未处理,还有飞线:对应器件就近管脚放置:过孔数量根据载流大小计算下个数,再加2-4个过孔的裕量就可以了:底层器件尽量整体中心对齐放置:以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或

Allegro-弟子计划-李飞-PMU的PCB作业

电源管脚拉出来之后加粗到15MIL:HDMI差分组 组内等长以及组跟组等长误差没问题了。以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教:https://item.taobao.co

Allegro-弟子计划-黄婷婷-HDMI模块PCB设计作业

电源输出应打孔到最后一个器件后方器件摆放干涉,电容到芯片要保留一些间距,不能靠的太近以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教:https://item.taobao.com/

90天全能特训班20期-AD-思乐-4层DM642达芬奇开发板

电源反馈信号要从最后一个器件连线,过孔要打到最后一个器件后方焊盘出线避免从长边出线布线保持3w间距规则以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教:https://item.ta

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Allaegro-弟子计划-刘用华的DDR3-FLY BY 的pcb的设计作业