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答：我们在进行PCB设计的时候，导入DXF文件后者其它参照的对象，都会在PCB中新建一些subclas层，累计的多了，subclass层就会非常多，所以我们这里讲解一下，如何去删除自己新建的subclass层，具体操作如下所示：
答：使用Allegro走线的时候，可以动态地显露走线的长度信息，具体操作的步骤如下所示：首先，点击Setup-User Preferences，在弹出的User Preferences Editor选项卡中勾选
答：我们在PCB设计中经常听到需要漏铜处理，或者是这里我要铺白油，这在PCB板上非常好理解，生产出来黄色的就是铜，白色一块的就是白油。我们这里讲解一下，在Allegro软件中如何处理，具体操作如下所示：
答：我们在PCB设计时，都会进行规则的设置，然后使用规则来约束设计，进行DRC的监测。我们这里讲解一下，soldemask也就是阻焊到其它元素的间距应该如何设置呢，具体操作的方法如下所示：
答：我们在PCB设计中，经常会遇到一些异形的板框，比如做FPC设计、LED灯板设计，如图6-286所示，我们PCB走线都是按45度走线，直接去走，很能走的规范，到板边的间距是一致的，这里讲解一下，如何设置一下，让走线沿着PCB板框按一定的规律进行布线，具体操作如下所示：
答：一般在使用Allegro软件设计时，铺铜都会铺实铜，但是对于如FPC设计，通常需要铺网格铜，以满足PCB的弯折性要求。具体操作的步骤如下所示：第一步，首先使用Shape-Polygen选项，在PCB上画一个铜皮，此时画出来的铜皮是实心的，如图6-297所示；
答：我们在PCB中进行布线的时候，高速信号先都是需要做阻抗设计的，做阻抗设计必须要有完整的参考平面，为了保证阻抗的连续性，高速信号尽量不要跨分割，所以我们在设计过程中都需要进行检查，具体操作步骤如下所示：
答：我们在进行差分布线设计的时候，特别是高速信号差分，在进行打孔换层的时候，都会在旁边添加回流地过孔，若差分信号比较多的时候，去添加，就非常繁琐，也容易遗漏，我么这里讲解一下，如何去进行自动添加，具体操作如下所示：
答：我们PCB布局完成之后，需要对网络进行扇出，一般空的管脚、空的网络不需要进行扇出，为了提高布线效率，我们会对空的网络进行高亮显示，具体的操作步骤如下所示：
