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锯齿状等长不能超过线距的两倍2.差分出线需要优化一下3.滤波电容放置有问题，有网络没有导入成功4.这几个应该是一个网络，滤波电容靠近对应的管脚放置5.器件摆放不要挡住一脚标识6.TX和RX要添加等长组分别进行等长，误差100mil7.存在s
焊盘出现需要优化一下2.差分对内等长误差5mil3.其他没什么问题USB2.0注意差分走线要满足车分间距规则以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或扫码联系助教：https://item
地网络在GND层欧通进行连接2.TX和RX要分别进行等长，误差100mil3.差分走线不满足差分间距要求4.锯齿状等长不能超过线距的两倍5.差分出线要尽量耦合6.差分对内等长误差5mil7.焊盘出线不规范，焊盘中心出线至外部才能拐线处理，避
1.线宽要保持一致，线宽不一致会导致阻抗不连续。2.TF卡的时钟信号，与其他信号线的间距保证20mil左右，有空 间的情况下，包地处理。3.数据线等长错误，避免绕90度角等长。4.铺铜存在多处孤岛铜和尖岬铜皮以上评审报告来源于凡亿教育90天
1，焊盘有开路。2.pcb存在drc4.多处孤岛铜皮和尖岬铜皮4.走线保持3w间距4.走线避免锐角5.差分换层旁边要打地过孔6.晶振布线错误，晶振的一对线要走成类差分的形式，并整体包地处理， 线尽量短如下图8.同层连接不需要打孔9.时钟线要
1.存在开路，孤岛铜皮没有连接出去。2.芯片中间过孔没有连接出去导致天线报错。3.多处孤岛铜皮和尖岬铜皮。4.电容地网络要和电源一样加宽载流。5.差分焊盘出线尽量耦合6.差分走线不耦合7.时钟信号走线要包地处理8.走线尽量短9.TX、RX没
电感所在层测内部需要挖空处理2.地分割间距最少控制1mm以上，有跨接器件的地方不满足可以忽略，其他地方尽量一致3.除差分线外，其他的都需要加粗到20mil4.注意过孔尽量不要上焊盘5.注意等长线之间需要满足3W6.地址线也需要添加等长组进行
锯齿状等长不能超过线距的两倍2.线宽尽量保持一致3.时钟要靠近管脚放置，并且包地处理4.走线也不规范，需要优化一下5.此处电源不满足载流6.TX和RX需要添加class，并进行等长处理，误差100mil7.TX,RX之间需要走一根20mil
1.变压器下方需要在所有层单独放置铺铜挖空，例如顶层放一个底层再放一个铺铜挖空。2.电源电容的输入输出都需要加粗载流。3.顶底层需要整版铺地铜处理4.TX等长组需要建立xSignals，前后段合并一起等长5.差分对内等长误差要控制在5mil
锯齿状等长不能超过线距的两倍很多差分都存在相同的问题，后期自己修改一下2.焊盘出线不规范，焊盘中心出线至外部才能拐线处理，避免生产出现虚焊3.CC1属于重要信号，需要加粗处理4.ESD器件尽量靠近座子管脚放置5.差分出线要尽量耦合6.器件摆
