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当对allegro软件PCB层叠结构进行设置的时候,某一层可以设置为pLANe或者conduct,平面层和走线层。但是我发现无论是设置成pLANe还是conduct,这一层都可以走线,手动铺铜皮,edit-split creat这样去灌铜进行铜皮分割。既然这样,那么设置层的时候,pLANe和cond

第二层可以布线,但是pLANe层为什么可以布线?是不是第二层设置成了信号层然后铺铜了?

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第二层可以布线,但是pLANe层为什么可以布线?是不是第二层设置成了信号层然后铺铜了?

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DRC的时候出现了Copper isLANd connected to pads/vias detected的提示该怎么修稿