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默认的在0.15左右,是符合规范的看一下推荐图两个边加起来0.15默认的好像不能改,没必要改

不还是会要出现从总线上分线头出来的问题所以个人认为在非必要情况下,只要不小于90°,都是可接受的DDR3/4里面,多片FLASH,这种情况很常见

原理图编译里面比如hAS no driving source 以及 off grid net label都不用管吗去掉 no ERC就一大堆报错,不去掉就没有报错

但再次打开pads软件还是提示这个图片

PADS导出ASC文件,为什么AD导入是生成PCB文件后显示的内容为空的

4层核心板视频讲解flASh地址线等长的时候,为什么A15-A19这几根线按照2800mil走,而不是参考A0-A14的长度,这样A0-19长度不一样,信号延时不是不相等吗?

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17611570878 2022-06-20 21:23:10

我用正点原子的ST-LINK/V2连接STM32F103C8T6,用的是SWD模式。但老识别不出芯片来,接线没有问题,是新芯片没有烧过程序,在网上找了方法没用,想问问有没有以前出现过类似情况的,如何解决啊?显示问题为:Error: FlASh Download failed-Target DLL h

我用正点原子的ST-LINK/V2连接STM32F103C8T6,用的是SWD模式。但老识别不出芯片来,接线没有问题,是新芯片没有烧过程序,在网上找了方法没用,想问问有没有以前出现过类似情况的,如何解决啊?显示问题为:Error: FlASh Download failed-Target DLL h