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相同网络的铜皮没有连接在一起，后期自己修改一下铜皮设置，重启铺铜2.USB差分需要进行对内等长，误差5mil3.输入的过孔要打在电容的前面4.此处铜皮会出线载流瓶颈，自己在此处放置一块填充扩大载流路径5.输出过孔要打在最后一个电容的后面6.
注意过孔间距，不要造成平面铜皮割裂：注意地址控制时钟组跟数据组可以用GND走线间隔开：下面的数据一致用GND走线隔开：其他的走线等长没什么问题了。以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班课程可以访问链接或
晶振靠近管脚放置，尽量少打孔换层，包地处理2.差分包地地线上需要多打地过孔3.器件摆放尽量对齐处理4.注意过孔不要上焊盘后期自己检查一下过孔上焊盘和过孔重叠5.信号包地应该用地网络，不要用电源6.SD卡组内误差不能超过400mil7.注意走
1.电源输入应该多打过孔加大载流2.差分布线避免直角，换层应靠近打一对回流地过孔3.晶振需要包地处理4.232C+C-,V+V-所接电容需要加粗走线
在PCB设计中，过孔的数量将决定着PCB的可靠性和连通性，而过孔数量是根据电路板的需求来决定，然而有时候在设计过程中难免会遇见PCB板上过孔数量过多的问题，那么如何解决？1、优化设计①合并功能相似的元件：在设计过程中，可考虑合并功能相似的元
差分线锯齿状等长不能超过线距的两倍2.差分对内等长误差5mil3.差分出线要尽量耦合4.走线需要优化一下5.RX和TX要创建class，进行等长处理，误差100mil6.时钟信号需要包地处理7.注意除了散热过孔其他的都可以盖油处理8.注意线
跨接器件旁边尽量多打地过孔，间距最少1.5mm，有器件的地方可以不满足，其他地方尽量满足2.网口差差分外，其他信号需要加粗到20mil3.差分线可以在优化一下4.滤波电容靠近管脚摆放，器件可以放底层5.走线与焊盘同宽，拉出来再进行加粗6.晶
注意电源输出主干道的器件尽量是中心对齐下，还可以优化：看下电源输入输出对应的GND如果需要单点接地就直接在中间的IC散热焊盘上打地过孔即可，其他的过孔删除：注意铜皮尽量用动态铜皮：其他的没什么问题了。以上评审报告来源于凡亿教育90天高速PC
能铺完一整块铜皮的就一次铺完，优化下：过孔打在第一个电容输入前面：上述一致问题，能铺完的就整体铺完，不要太多这种碎铜：铺铜尽量美观，不要直角锐角，尽量全部钝角铺铜：不合格的铜皮都重新绘制铺配置电阻电容还有飞线，没有连接：注意焊盘出线注意规范
电容要靠近管脚摆放2.走线需要再优化一下， 可直接连接上过孔3.电容靠近管脚放置4.TX和RX之间尽量走一根地线进行分割，或者保持20mil间距5.时钟信号需要包地以上评审报告来源于凡亿教育90天高速PCB特训班作业评审如需了解PCB特训班
