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导出网表时,Capture弹窗这个是什么原因造成的,然后软件强行关闭了有同学遇到这样的问题么昨天的原理图生成网表没有问题然后今天改了下原理图,重新生成网表,软件就报错了

Cadence Allegro导入DXF时候,对于底视图不能镜像的原因是什么呢?

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AD21!在画原理图时感觉A4图纸太小了,然后右击->原理图优先项===修改图纸大小(如设A3)。但是图纸是没有增大的,是什么原因?过去的protel,DXP,旧的AD09都没有此问题,当前电脑系统是W10;谁能解决

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春回复苏 2022-06-21 11:27:27

AD21!在画原理图时感觉A4图纸太小了,然后右击->原理图优先项===修改图纸大小(如设A3)。但是图纸是没有增大的,是什么原因?过去的protel,DXP,旧的AD09都没有此问题,当前电脑系统是W10;谁能解决

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春回复苏 2022-06-21 11:27:28

AD软件PCB里面差分线上出现网格线是什么原因啊?无法选中,如何解决

BGA封装自动扇孔为什么扇出不成功?有哪些原因?这是设置的规则

从PADS转过来的PCB到allegro中, 不显示Pin Number ,但是查询看是有pin number的,啥原因

生成drill legend的时候,盘中孔报如下错误,一个正八边形中间有个×,应该是没有生成。请问下,是什么原因,要如何解决?

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2022-06-26 16:19:37

规则设置也没盖油正常不是这样的嘛