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cadence allegro Allow test directly on pad：允许测试点在焊盘上，允许时将自动替换已有的过孔。Allow test directly on trace：允许测试点在信号线上，允许时测试点可以直接在信号线上。Allow pin escape insertion：允许从引脚上自动引出测试点。Test unused pins：无网络引脚添加测试点。
Allegro因其功能强大、界面灵活、可适应切换复杂项目的需求，很快成为全球最受欢迎的EDA软件之一，而很多工程师在Allegro软件中添加测试点，这样做的好处是为了进行电路的功能测试和故障诊断，那么如何在Allegro添加/生成测试点？下
答：一般情况下，我们推荐位号字符在与阻焊不干涉的情况下，推荐位号字符与SMD焊盘、插装焊接孔、测试点、Mark点至少保证6mil的间距，位号字符之间部分重合是可以的，任何位号字符由于重叠导致的无法辨认必须进行调整。
晶振需要走内差分形式2.测试点不要放在过孔上面3.差分对内等长误差为5mil4.走线未完全连接，存在开路5.走线不要从小器件中间穿，后期维修容易造成短路
答：ICT (In Circuit Tester，自动在线测试仪)是印制电路板生产中重要的测试设备:用于焊接后快速测试元器件的焊接质量，能迅速定位焊接不良的引脚，以便及时进行补焊。体现在PCB设计上，则需要在设计中添加用于ICT测试的焊盘，并对符合测试点要求的焊盘添加测试点属性。因测试点焊盘和间距及位置有严格的要求，对于有ICT设计要求的板卡，建议在设计前就明确添加ICT的网络，拟定ICT的添加计划，在设计的过程中边布线边添加。如果在设计完后再添加ICT测试点，必将大量返工，甚至有的网络根本无法
答：一般情况下，我们推荐位号字符在与阻焊不干涉的情况下，推荐位号字符与SMD焊盘、插装焊接孔、测试点、Mark点至少保证6mil的间距，位号字符之间部分重合是可以的，任何位号字符由于重叠导致的无法辨认必须进行调整。位号字符的方向设定，一般推荐在正视的情况下，位号字符的排列是从左到右，从上到下的，如图1-30所示，TOP面与Bottom面的位号字符排列。 图1-30 TOP面与Bottom面的位号字符排列示意图
PADS Router组件内设计规则包括层、栅格、扇出、焊盘入口、拓扑、安全间距、布线、过孔配置、设置布线层、同一网络、测试点等规则。一般会对层、扇出、安全间距、布线、过孔配置、设置布线层这几项进行设置，其他项按默认选项。执行“编辑-特性”
和Pads Layout组件类似，PADS Router组件使用前，可执行菜单“工具-选项”，进行默认选项参数设置，常用设计选项包括全局、颜色、显示、布局、正在填充、文本和线、布线、测试点、制造、设计验证等。如图6-6所示。部分设置选项是与
