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差分线处理不当,锯齿状等长,凸起高度不得超过线距的两倍
2.器件摆放尽量对齐处理
3.晶振走线需要走类差分处理
4.电源输入的滤波电容应该靠近输入管脚(4脚)放置
5.此处在一层走线即可,建议铺铜处理
6.时钟包地需要在地上间隔150mil-200mil打上一个地过孔
前期为了满足各项设计的要求,通常会设置很多约束规则,当一个PCB设计完成之后,通常要进行DRC。DRC就是检查设计是否满足所设置的规则。一个完整的PCB设计必须经过各项连接性规则检查,常见的检查包括开路及短路的检查,更加严格的还有差分对、阻
差分线处理不当,锯齿状等长,凸起高度不得超过线距的两倍2.器件摆放尽量对齐处理3.晶振走线需要走类差分处理4.电源输入的滤波电容应该靠近输入管脚(4脚)放置5.此处在一层走线即可,建议铺铜处理6.时钟包地需要在地上间隔150mil-200m
器件摆放注意局部对齐处理2.注意器件干涉3.电源输出的滤波电容要靠近输出管脚放置4.电源输入输出换层打孔处理不当,输入应该打在滤波电容的前面,输出打在滤波电容的后面5..差分线处理不当,锯齿状等长,凸起高度不得超过线距的两倍6.确认一下此处
1.电源输入的滤波电容应该靠近输入管脚(4脚)放置2.差分线处理不当,锯齿状等长,凸起高度不得超过线距的两倍3.差分要尽量耦合出线,后期自己调整一下走线路劲4.此处电源出线载流瓶颈,电流计算都是以最窄处铜皮计算的5.线宽突变,确认一下具体线
一、丝印位号调整针对后期元件装配,特别是手工装配元件,一般都得输出PCB的装配图,用于元件放料定位之用,这时丝印位号就显示出其必要性了。生产时PCB上丝印位号可以进行显示或者隐藏,但是不影响装配图的输出。在右侧的图层菜单栏里,按全部按钮,即
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